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确定如何信号进行比较,以指定的恒定
万博1manbetx的Simulink /逻辑与位运算
HDL编码器/逻辑和位运算
在比较恒定块输入信号以恒定的相比较。指定要在不断的恒值参数。指定输入相比如何与恒定值操作者参数。
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PORT_1
输入信号,指定为一个标量,用zero.The块第一转换相比其恒值参数对输入数据类型,然后执行指定的操作。
数据类型:单|双|INT8|INT16|INT32|Int64的|UINT8|UINT16|UINT32|UINT64|布尔|固定点|枚举|总线
单
双
INT8
INT16
INT32
Int64的
UINT8
UINT16
UINT32
UINT64
布尔
固定点
枚举
总线
输出是0如果比较是错误的,1如果这是真的。
0
1
数据类型:UINT8|布尔
操作者
此参数可以有以下值:
==- 确定所述输入是否等于指定的常数。
==
〜=- 确定所述输入是否不等于指定的常数。
=
<- 确定所述输入是否小于指定的常数。
<
<=- 确定所述输入是否小于或等于指定的常数。
<=
>- 确定输入是否大于指定常数。
>
> =- 确定输入是否大于或等于指定的常数。
> =
relop
'=='
'〜='
'<'
'<='
'> ='
'>'
恒值
指明该输入被比较的恒定值。
常量
'3.0'
输出数据类型
指定输出的数据类型,布尔要么UINT8。
OutDataTypeStr
“布尔”
'UINT8'
使过零检测
选择启用过零检测。欲了解更多信息,请参阅过零检测。
过零
“关”
'上'
使用MATLAB系统块,说明大数定律。
数据类型
布尔|双|枚举|固定点|整数|单
整数
直接馈通
没有
多维信号
是
可变大小信号
过零检测
HDL编码器™提供了影响HDL实现并合成逻辑额外配置选项。
此块有一个单一的,默认的HDL架构。
寄存器数由您的设计中移动现有的延迟在输出端放置。分布式流水线不引入这些寄存器。默认值是0。有关详细信息,请参阅ConstrainedOutputPipeline(HDL编码器)。
输入流水线阶段的数量在生成的代码中插入。分布式流水线和约束输出流水线可以移动这些寄存器。默认值是0。有关详细信息,请参阅InputPipeline(HDL编码器)。
输出流水线阶段的数量在生成的代码中插入。分布式流水线和约束输出流水线可以移动这些寄存器。默认值是0。有关详细信息,请参阅OutputPipeline(HDL编码器)。
此块支持复杂的信号代码万博1manbetx生成。
组合逻辑|与0比较|逻辑运算符
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