现实想象到复杂

将真实和/或假想输入转换为复杂信号

图书馆：
Simulink / Math Operations

描述

这现实想象到复杂块将真实和/或假想输入转换为复杂值的输出信号。

输入既可以是相等尺寸的数组（向量或矩阵），也可以是一个输入可以是数组，另一个输入可以是标量。如果块具有数组输入，则输出是相同维度的复杂阵列。真实输入映射的元素到相应的复杂输出元素的真实部分。假想的输入类似地映射到复杂输出信号的假想部分。如果一个输入是标量，则将其映射到所有复杂输出信号的相应组件（真实或虚构）。

端口

Input

展开全部

`回覆`- 复杂输出的真正部分
标量|vector | matrix

实际值将转换为复杂值的输出信号，该信号指定为标量，向量或矩阵。

`我是`- 复杂输出的虚构部分
标量|vector | matrix

假想值将转换为复杂值的输出信号，该信号指定为标量，向量或矩阵。

`port_1`- 复杂输出的真实或虚构部分
标量|vector | matrix

真实或假想的值转换为复杂的输出信号，指定为有限标量，向量或矩阵。

输出

展开全部

`port_1`- 复杂的信号
标量|vector | matrix

复杂的信号，由真实和假想的值形成。

数据类型：单身的|双倍的|int8|int16|INT32|UINT8|UINT16|UINT32|fixed point

参数

展开全部

`Input`- 真实，虚构或两者兼而有之
`回覆al`（默认）|`图像`|`真实和图像`

指定输入的类型：真实输入，虚构输入或两者兼而有之。

程序化使用

块参数：Input

类型：角色向量

值：“真实和图像” |“真实” |“图像”

默认：'Real and imag'

`图像部分`- 复杂输出的虚构部分
`0`（默认）|有限标量，向量或矩阵

在将输入转换为复杂值的输出信号时，指定要使用的假想值。

依赖性

要启用此参数，请设置Input至回覆al。

程序化使用

块参数：ConstantPart

类型：角色向量

值：imaginary value

默认：'0'

`真实的部分`- 复杂输出的真正部分
`0`（默认）|有限标量，向量或矩阵

在将输入转换为复杂值的输出信号时，指定要使用的常数实际值。

依赖性

要启用此参数，请设置Input至图像。

程序化使用

块参数：ConstantPart

类型：角色向量

值：finite, real-valued scalar, vector, or matrix

默认：'0'

`采样时间`- 将示例时间指定为一个值`-1`
`-1`（默认）|标量

将样本时间指定为-1以外的值。有关更多信息，请参阅指定样本时间。

依赖性

这个参数是不可见的,除非它是explicitly set to a value other than-1。要了解更多，请参阅不建议使用样品时间的块。

程序化使用

块参数：采样时间

类型：角色向量

值：标量

默认：'-1'

模型示例

Construct Complex Signal from Real and Imaginary Parts

此示例显示了如何将真实想法到复杂块中的实数来构造来自真实和虚部的复杂值信号。您可以将真实和虚部作为块输入提供，或提供一个值作为输入，另一个值在“块”对话框上。

Open Model

Block Characteristics

数据类型	`双倍的`\|`单身的`\|`基础整数`\|`fixed point`
多维信号	`是的`
可变大小信号	`是的`

扩展功能

C/C ++代码生成
使用Simulink®Coder™生成C和C ++代码。万博1manbetx

HDL代码生成
Generate Verilog and VHDL code for FPGA and ASIC designs using HDL Coder™.

有关HDL代码生成的更多信息，请参阅现实想象到复杂。

定点转换
使用固定点Designer™将浮点算法转换为固定点。

也可以看看

复杂到大小角度|Complex to Real-Imag|Magnitude-Angle to Complex

话题

复杂的信号

Introduced before R2006a

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文档

现实想象到复杂

描述

端口

Input

`回覆`- 复杂输出的真正部分
标量|vector | matrix

`我是`- 复杂输出的虚构部分
标量|vector | matrix

`port_1`- 复杂输出的真实或虚构部分
标量|vector | matrix

输出

`port_1`- 复杂的信号
标量|vector | matrix

参数

`Input`- 真实，虚构或两者兼而有之
`回覆al`（默认）|`图像`|`真实和图像`

程序化使用

`图像部分`- 复杂输出的虚构部分
`0`（默认）|有限标量，向量或矩阵

依赖性

程序化使用

`真实的部分`- 复杂输出的真正部分
`0`（默认）|有限标量，向量或矩阵

依赖性

程序化使用

`采样时间`- 将示例时间指定为一个值`-1`
`-1`（默认）|标量

依赖性

程序化使用

模型示例

Construct Complex Signal from Real and Imaginary Parts

Block Characteristics

扩展功能

C/C ++代码生成
使用Simulink®Coder™生成C和C ++代码。万博1manbetx

HDL代码生成
Generate Verilog and VHDL code for FPGA and ASIC designs using HDL Coder™.

定点转换
使用固定点Designer™将浮点算法转换为固定点。

也可以看看

话题

Introduced before R2006a

万博1manbetxSimulink文档

万博1manbetx

尝试MATLAB，SIM万博1manbetxULINK和其他产品s manbetx 845

文档

现实想象到复杂

描述

端口

Input

回覆- 复杂输出的真正部分标量|vector | matrix

我是- 复杂输出的虚构部分标量|vector | matrix

port_1- 复杂输出的真实或虚构部分标量|vector | matrix

输出

port_1- 复杂的信号标量|vector | matrix

参数

Input- 真实，虚构或两者兼而有之回覆al（默认）|图像|真实和图像

程序化使用

图像部分- 复杂输出的虚构部分0（默认）|有限标量，向量或矩阵

依赖性

程序化使用

真实的部分- 复杂输出的真正部分0（默认）|有限标量，向量或矩阵

依赖性

程序化使用

采样时间- 将示例时间指定为一个值-1-1（默认）|标量

依赖性

程序化使用

模型示例

Construct Complex Signal from Real and Imaginary Parts

Block Characteristics

扩展功能

C/C ++代码生成使用Simulink®Coder™生成C和C ++代码。万博1manbetx

HDL代码生成Generate Verilog and VHDL code for FPGA and ASIC designs using HDL Coder™.

定点转换使用固定点Designer™将浮点算法转换为固定点。

也可以看看

话题

Introduced before R2006a

万博1manbetxSimulink文档

万博1manbetx

尝试MATLAB，SIM万博1manbetxULINK和其他产品s manbetx 845

`回覆`- 复杂输出的真正部分
标量|vector | matrix

`我是`- 复杂输出的虚构部分
标量|vector | matrix

`port_1`- 复杂输出的真实或虚构部分
标量|vector | matrix

`port_1`- 复杂的信号
标量|vector | matrix

`Input`- 真实，虚构或两者兼而有之
`回覆al`（默认）|`图像`|`真实和图像`

`图像部分`- 复杂输出的虚构部分
`0`（默认）|有限标量，向量或矩阵

`真实的部分`- 复杂输出的真正部分
`0`（默认）|有限标量，向量或矩阵

`采样时间`- 将示例时间指定为一个值`-1`
`-1`（默认）|标量

C/C ++代码生成
使用Simulink®Coder™生成C和C ++代码。万博1manbetx

HDL代码生成
Generate Verilog and VHDL code for FPGA and ASIC designs using HDL Coder™.

定点转换
使用固定点Designer™将浮点算法转换为固定点。